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設(shè)計和開發(fā)資源
JESD204 快速設(shè)計 IP,用于連接到 TI 高速數(shù)據(jù)轉(zhuǎn)換器的 FPGA
JESD204 快速設(shè)計 IP 旨在為 FPGA 工程師提供一條快速通往運行中的 JESD204 系統(tǒng)的路徑。該 IP 經(jīng)過特別設(shè)計,可將下游數(shù)字處理和其他應(yīng)用邏輯與 JESD204 協(xié)議的大多數(shù)性能和時序關(guān)鍵型限制因素隔離開。該 IP 將幫助設(shè)計人員節(jié)省固件開發(fā)時間并簡化 FPGA 集成。
當您使用 TI 的高速數(shù)據(jù)轉(zhuǎn)換器時,可免專利費使用 JESD204 快速設(shè)計 IP。TI 將協(xié)助用戶配置初始鏈路,對其進行定制,以便在特定 FPGA 平臺和 TI 數(shù)據(jù)轉(zhuǎn)換器 JMODE 之間使用。在對該 IP 進行測試并確定其可以用于部署工作之后,TI 將會通過安全的下載鏈接提供該 IP。
JESD204 (...)
具有雙通道 14 位 3GSPS ADC/9GSPS DAC 時鐘解決方案的 2T2R 射頻采樣收發(fā)器評估模塊
TSW40RF80 評估模塊 (EVM) 是一種雙發(fā)雙收 (2T2R) 射頻采樣收發(fā)器參考設(shè)計。該模塊包含 DAC38RF80 雙通道射頻采樣數(shù)模轉(zhuǎn)換器 (DAC) 和 ADC32RF45 雙通道射頻采樣模數(shù)轉(zhuǎn)換器 (ADC)。
DAC38RF80 采樣率高達 9GSPS,包括用于高頻時鐘生成的板載 PLL/VCO。輸出是單端的,便于連接 50Ω 的電路。ADC32RF45 采樣率高達 3GSPS。它可以選擇在每個通道中使用雙數(shù)字下變頻器,或者通過旁路訪問奈奎斯特全帶寬。
TSW40RF80EVM 包括 LMK04828 時鐘發(fā)生器,用于為 DAC PLL 提供參考信號,以及用于生成 (...)