DS90LV032A
- >400 Mbps (200 MHz) Switching Rates
- 0.1-ns Channel-to-Channel Skew (Typical)
- 0.1-ns Differential Skew (Typical)
- 3.3-ns Maximum Propagation Delay
- 3.3-V Power Supply Design
- Power Down High Impedance on LVDS Inputs
- Low Power Design (40 mW at 3.3 V Static)
- Interoperable With Existing 5-V LVDS Networks
- Accepts Small Swing (350 mV Typical) VID
- Supports Open, Short, and Terminated Input Fail-Safe
- Compatible With ANSI/TIA/EIA-644
- Industrial Temperature Operating Range (–40°C to 85°C)
- Available in SOIC and TSSOP Packaging
The DS90LV032A is a quad CMOS differential line receiver designed for applications requiring ultra-low power dissipation and high data rates. The device is designed to support data rates in excess of 400 Mbps (200 MHz) using Low Voltage Differential Signaling (LVDS) technology.
The DS90LV032A accepts low voltage (350 mV typical) differential input signals and translates them to 3-V CMOS output levels. The receiver supports a TRI-STATE function that may be used to multiplex outputs. The receiver also supports open, shorted, and terminated (100 Ω) input Fail-safe. The receiver output is HIGH for all fail-safe conditions.
The DS90LV032A and companion LVDS line driver (for example, DS90LV031A) provide a new alternative to high power PECL or ECL devices for high speed point-to-point interface applications.
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| 應(yīng)用簡報 | How Far, How Fast Can You Operate LVDS Drivers and Receivers? | 2018年 8月 3日 | ||||
| 應(yīng)用簡報 | How to Terminate LVDS Connections with DC and AC Coupling | 2018年 5月 16日 | ||||
| 更多文獻資料 | Die D/S DS90LV032A MDS (PRELIMINARY) 3V LVDS Quad CMOS Diff Line Receive | 2012年 12月 20日 | ||||
| 應(yīng)用手冊 | AN-1110 LVDS Quad Dynamic I CC vs Frequency | 2004年 5月 15日 | ||||
| 應(yīng)用手冊 | An Overview of LVDS Technology | 1998年 10月 5日 |
設(shè)計與開發(fā)
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