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ZHCSTG5A October 2023 – February 2025 ADC12QJ1600-SEP

PRODUCTION DATA

封裝選項(xiàng)

請參考 PDF 數(shù)據(jù)表獲取器件具體的封裝圖。

機(jī)械數(shù)據(jù) (封裝 | 引腳)

ALR|144

散熱焊盤機(jī)械數(shù)據(jù) (封裝 | 引腳)

訂購信息

5.5 電氣特性：直流規(guī)格

在 T_J = 50°C 時的典型值、VA19 = 1.9V、VPLL19 = 1.9V、VREFO = 1.9V、VTRIG = 1.1V、VA11 = 1.1V、VD11 = 1.1V、默認(rèn)滿量程電壓 (V_FS = 0.8V_PP) 、f_IN = 97MHz、A_IN =–1dBFS、f_CLK = 1.6GHz、CLK± 上使用的濾波 1-V_PP 正弦波時鐘、PLL 禁用、JMODE = 0，高性能模式和前臺校準(zhǔn)（除非另有說明）；在標(biāo)稱電源電壓下的最小值和最大值及超過 建議運(yùn)行條件 表所述的工作結(jié)溫范圍

參數(shù)		測試條件	最小值	典型值	最大值	單位
直流精度
	分辨率	無代碼丟失時的分辨率		12		位
DNL	微分非線性	距離理想步長的最大正偏移		0.2		LSB
DNL	微分非線性	距離理想步長的最大負(fù)偏移		-0.19		LSB
INL	積分非線性	距離理想傳遞函數(shù)的最大正偏移		1.95		LSB
INL	積分非線性	距離理想傳遞函數(shù)的最大負(fù)偏移		-1.5		LSB
模擬輸入（INA+、INA-、INB+、INB–）
V_OFF	偏移誤差	CAL_OS = 0		±0.6		mV
V_OFF	偏移誤差	CAL_OS = 1		±0.6		mV
V_{OFF_ADJ}	輸入失調(diào)電壓調(diào)節(jié)范圍	可用的偏移校正范圍（請參見 OFSx 或 OFSxCh 寄存器）		±33		mV
V_{OFF_DRIFT}	偏移漂移	僅限標(biāo)稱溫度下的前臺校準(zhǔn)，CAL_OS = 1		-1.2		μV/°C
V_{OFF_DRIFT}	偏移漂移	每個溫度下的前臺校準(zhǔn)，CAL_OS = 1		0.25		μV/°C
V_FS	模擬差分輸入滿量程	在直流條件下測量的默認(rèn)滿量程電壓 (FS_RANGE = 0xA000)	750	800	850	mV_PP
		在直流條件下測量的最大滿量程電壓 (FS_RANGE = 0xFFFF)	980	1040
		在直流條件下測量的最小滿量程電壓 (FS_RANGE = 0x2000)		480	500
V_{FS_DRIFT}	模擬差分輸入滿量程范圍漂移	默認(rèn) FS_RANGE 設(shè)置，僅在標(biāo)稱溫度下進(jìn)行前臺校準(zhǔn)，由 50Ω 源驅(qū)動的輸入，包括 R_IN 漂移的影響		-0.0015		%/°C
V_{FS_DRIFT}	模擬差分輸入滿量程范圍漂移	默認(rèn) FS_RANGE 設(shè)置，每個溫度下的前臺校準(zhǔn)，由 50Ω 源驅(qū)動的輸入，包括 R_IN 漂移的影響		-.000018		%/°C
V_{FS_MATCH}	模擬差分輸入滿量程范圍匹配	匹配任意兩個通道（例如 INA± 和 INB±），在直流條件下測量的默認(rèn)滿量程電壓		1%
R_IN	差分輸入電阻	差分電阻的中心端接至 V_CM，在 T_A = 25°C 時測量	92	100	108	Ω
R_{IN_TEMPCO}	輸入終端線性溫度系數(shù)			38		mΩ/°C
C_IN	單端輸入電容	在 DC 下測得		0.6		pF
溫度二極管特性 (TDIODE+、TDIODE-)
ΔV_BE	溫度二極管電壓斜率	100μA 的強(qiáng)制正向電流。失調(diào)電壓（在 0°C 時約為 0.792V）隨工藝不同而變化，必須針對每個器件進(jìn)行測量。必須在器件未上電或 PD 引腳置位的情況下完成失調(diào)電壓測量，以更大限度地減少器件自發(fā)熱。		-1.6		mV/°C
帶隙電壓輸出 (BG)
V_BG	內(nèi)部帶隙基準(zhǔn)和 V_CM 基準(zhǔn)輸出電壓	I_L ≤ 100μA		1.1		V
V_{BG_DRIFT}	V_BG 輸出溫度漂移	I_L ≤ 100μA		-117		μV/°C
差分時鐘和時間戳輸入 (CLK+、CLK–、SYSREF+、SYSREF–、TMSTP+、TMSTP–)
Z_T	內(nèi)部端接	DEVCLK_LVPECL_EN = 0、SYSREF_LVPECL_EN = 0 且 TMSTP_LVPECL_EN = 0 時的差分終端		100		Ω
Z_T	內(nèi)部端接	在 DEVCLK_LVPECL_EN = 0、SYSREF_LVPECL_EN = 0、TMSTP_LVPECL_EN = 0 時單端終端至 GND （每引腳）		50		Ω
V_CM	輸入共模電壓自偏置	交流耦合時 CLK± 的自偏置共模電壓（DEVCLK_LVPECL_EN 必須設(shè)置為 0)		0.3		V
		在交流耦合時（SYSREF_LVPECL_EN 必須設(shè)置為 0）且接收器啟用 (SYSREF_RECV_EN = 1) 時，SYSREF± 的自偏置共模電壓		0.3
		在交流耦合（SYSREF_LVPECL_EN 必須設(shè)置為 0）且接收器被禁用 (SYSREF_RECV_EN = 0) 時，SYSREF± 的自偏置共模電壓		VA11
C_{L_DIFF}	差分輸入電容	正負(fù)差分輸入引腳之間		0.1		pF
C_{L_SE}	單端輸入電容	每個輸入端接地		0.5		pF
時鐘和觸發(fā)器輸出 (PLLREFO+、PLLREFO–、TRIGOUT+、TRIGOUT–)
V_DIFF	差分輸出電壓、峰峰值、直流測量	100-Ω 負(fù)載	400	720	900	mV_PP-DIFF
V_CM(PLLREFO)	PLLREFO± 輸出共模電壓			1.31⁽¹⁾		V
V_CM(TRIGOUT)	TRIGOUT± 輸出共模電壓，通過 VTRIG 進(jìn)行跟蹤	VTRIG = 1.9		1.31⁽²⁾		V
V_CM(TRIGOUT)	TRIGOUT± 輸出共模電壓，通過 VTRIG 進(jìn)行跟蹤	VTRIG = 1.1		0.5⁽²⁾		V
Z_DIFF	差分輸出阻抗	在 DC 下測得		300		?
串行器/解串器輸出 (D[7：0]+，D[7：0]–)
V_OD	差分輸出電壓，峰峰值	100-Ω 負(fù)載		600		mV_PP-DIFF
V_CM	輸出共模電壓	交流耦合		0.54		V
Z_DIFF	差分輸出阻抗			100		Ω
CMOS 接口 (SCLK、SDI、SDO、SCS、PD、CALSTAT、CALTRIG、CLKCFG0、CLKCFG1、PLL_EN、PLLREF_SE、ORA、ORB、ORC、ORD) SYNCSE)
V_IH	高電平輸入電壓		0.7			V
V_IL	低電平輸入電壓				0.45	V
I_IH	高電平輸入電流				40	μA
I_IL	低電平輸入電流		-40			μA
C_I	輸入電容			2		pF
V_OH	高電平輸出電壓	I_LOAD = -400μA	1.65			V
V_OL	低電平輸出電壓	I_LOAD = 400μA			150	mV

(1) TI 建議在 PLLREFO± 啟用后將 PLLREFO± 交流耦合連接到負(fù)載器件。

(2) 當(dāng) TRIGOUT± 被啟用并被用作一個時鐘輸出（來自 S-PLL）時，TI 建議將 TRIGOUT± 交流耦合至負(fù)載器件。當(dāng) TRIGOUT± 被用作一個觸發(fā)輸出（來自 TMSTP±）時，TRIGOUT± 可被直流耦合至負(fù)載器件。