ZHCSYD5 June 2025 DAC39RF20
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請參考 PDF 數(shù)據(jù)表獲取器件具體的封裝圖。
表 8-10 列出了系統(tǒng)寄存器的存儲器映射寄存器。表 8-10 中未列出的所有寄存器偏移地址都應(yīng)視為保留的位置，并且不應(yīng)修改寄存器內(nèi)容。
| 偏移 | 首字母縮寫詞 | 寄存器名稱 | 部分 |
|---|---|---|---|
| 0x20 | SYS_EN | 節(jié) 8.3.2.1 | |
| 0x21 | FR_EN | 節(jié) 8.3.2.2 | |
| 0x22 | PWR_RAMP | 節(jié) 8.3.2.3 | |
| 0x23 | PWR_IDLE | 節(jié) 8.3.2.4 | |
| 0x24 | CMOS_BOOST | 節(jié) 8.3.2.5 | |
| 0x25 | TX_EN_SEL | 節(jié) 8.3.2.6 | |
| 0x26 | TX_EN | 節(jié) 8.3.2.7 | |
| 0x27 | TX_PIN_FUNC | 節(jié) 8.3.2.8 | |
| 0x28 | SYNCB_PIN_FUNC | 節(jié) 8.3.2.9 | |
| 0x2A | APP_SLEEP0 | 節(jié) 8.3.2.10 | |
| 0x2B | APP_SLEEP1 | 節(jié) 8.3.2.11 | |
| 0x2C | APP_SLEEP0_EN | 節(jié) 8.3.2.12 |
復(fù)雜的位訪問類型經(jīng)過編碼可適應(yīng)小型表單元。表 8-11 展示了適用于此部分中訪問類型的代碼。
| 訪問類型 | 代碼 | 說明 |
|---|---|---|
| 讀取類型 | ||
| R | R | 讀取 |
| R-0 | R -0 | 讀取 返回 0 |
| 寫入類型 | ||
| W | W | 寫入 |
| 復(fù)位或默認值 | ||
| -n | 復(fù)位后的值或默認值 | |
SYS_EN 如表 8-12 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-1 | RESERVED | R | 0x0 | |
| 0 | SYS_EN | R/W | 0x0 | 當 SYS_EN=0 時，所有從 DAC 時鐘運行的電路（除了熔絲控制器）被保持在復(fù)位狀態(tài)。時鐘關(guān)閉以省電。LMFC/LEMC 計數(shù)器也保持在復(fù)位狀態(tài)，因此 SYSREF 不會對齊 LMFC/LEMC。 注釋：僅當 FUSE_DONE=1 時，才應(yīng)將該寄存器從 0 更改為 1。 注釋：如果 CPLL_EN=1，則在 CPLL_LOCKED=1 之前不應(yīng)設(shè)置該位。
|
FR_EN 如表 8-13 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-1 | RESERVED | R | 0x0 | |
| 0 | FR_EN | R/W | 0x0 | FRI 利用 TRIG 引腳，使其不可用于觸發(fā) DSP。用戶可以使用 TX_PIN_FUNC 或 SYNCB_PIN_FUNC 將其他引腳作為觸發(fā)輸入分配。 注意：在更改 FR_EN 之前和之后，TRIGCLK 輸入應(yīng)是靜態(tài)的，TRIG[4] 應(yīng)保持高電平 30ns。 注意：僅當 FRI 接口空閑時，才應(yīng)更改該寄存器。
|
PWR_RAMP 如表 8-14 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-2 | RESERVED | R | 0x0 | |
| 1-0 | PWR_RAMP | R/W | 0x0 | 該寄存器控制在啟用數(shù)字元件時設(shè)計如何斜升功率。使用該寄存器可避免大浪涌電流。較高的設(shè)置將減小浪涌電流。設(shè)計將由于以下操作中的任一個將功率斜升： 1) 設(shè)置 SYS_EN=1 2) 將 MODE 調(diào)整到更高的功耗狀態(tài) 3) 使用引腳退出 APP 睡眠模式（請參閱 TX_PIN_FUNC / SYNCB_PIN_FUNC） 4) 通過 APP_SLEEP0/1 功能讓元件退出睡眠模式。 所有功耗區(qū)的最大波動時間： 0：4376 DACCLK 周期 1：20256 DACCLK 周期 2：252576 DACCLK 周期 3：3969696 個 DACCLK 周期 |
PWR_IDLE 如表 8-15 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-1 | RESERVED | R | 0x0 | |
| 0 | PWR_IDLE | R | X | 當功率控制器處于空閑狀態(tài)（沒有處于打開或關(guān)閉過程中的功耗區(qū)）時，此項會返回 1。該位也可驅(qū)動至 ALARM 引腳。請參閱 ALARM_TSEL。 |
CMOS_BOOST 如表 8-16 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-2 | RESERVED | R | 0x0 | |
| 1 | TRIGC_BOOST | R/W | 0x0 | 啟用 TRIGCLK 輸出的升壓特性。僅當 TRIGCLK 配置為輸出引腳時有效。 |
| 0 | SDO_BOOST | R/W | 0x0 | 啟用 SDO 輸出的升壓特性。 |
TX_EN_SEL 如表 8-17 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-4 | RESERVED | R | 0x0 | |
| 3 | IDLE_STATIC | R/W | 0x0 | 選擇禁用傳輸時 DAC 使用的方法（通過 txenable 或 TX_EN）
|
| 2-0 | RESERVED | R | 0x0 |
TX_EN 如表 8-18 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-2 | RESERVED | R | 0x0 | |
| 1 | TX_EN1 | R/W | 0x0 | 如果為低電平，則根據(jù) IDLE_STATIC 將 DACB 靜音。 |
| 0 | TX_EN0 | R/W | 0x0 | 如果為低電平，則根據(jù) IDLE_STATIC 將 DACA 靜音。 |
TX_PIN_FUNC 如表 8-19 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-4 | TX_PIN_FUNC1 | R/W | 0x0 | 定義 TXENABLE[1] 引腳的功能。當該引腳為低電平時會應(yīng)用這些操作。 注意：這些設(shè)置可與 TRIG_TYPEx=4 搭配使用。它們提供備用引腳來驅(qū)動觸發(fā)器系統(tǒng)，但不影響 FRI 接口（FRI 接口始終使用物理 TRIG 引腳）。如果將多個引腳配置為同一 TRIG[x] 引腳的備用輸入，則行為未定義。 注意：僅當 SYS_EN=0 時，才應(yīng)更改該寄存器。
|
| 3-0 | TX_PIN_FUNC0 | R/W | 0x0 | 定義 TXENABLE[0] 引腳的功能。當該引腳為低電平時會應(yīng)用這些操作。 注意：這些設(shè)置可與 TRIG_TYPEx=4 搭配使用。它們提供備用引腳來驅(qū)動觸發(fā)器系統(tǒng)，但不影響 FRI 接口（FRI 接口始終使用物理 TRIG 引腳）。如果將多個引腳配置為同一 TRIG[x] 引腳的備用輸入，則行為未定義。 注意：僅當 SYS_EN=0 時，才應(yīng)更改該寄存器。
|
SYNCB_PIN_FUNC 如表 8-20 所示。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-4 | RESERVED | R | 0x0 | |
| 3-0 | SYNCB_PIN_FUNC | R/W | 0x0 | 定義了 JENC=1 (64b/66b) 時 SYNCB 引腳的功能。當 JENC=0 (8b/10b) 時，該寄存器無效（SYNCB 由 JESD 接口使用）。 當該引腳為低電平時會應(yīng)用這些操作。注意：這些設(shè)置可與 TRIG_TYPEx=4 搭配使用。 它們提供備用引腳來驅(qū)動觸發(fā)器系統(tǒng)，但不影響 FRI 接口（FRI 接口始終使用物理 TRIG 引腳）。如果將多個引腳配置為同一 TRIG[x] 引腳的備用輸入，則行為未定義。 如果未使用 JESD 接口，則所有 DSP 都處于 DDS 模式且 JESD_M=0。但是，您仍必須設(shè)置 JENC=1 才能允許 SYNCB 引腳用作輸入信號。 注意：僅當 SYS_EN=0 時，才應(yīng)更改該寄存器。
|
表 8-21 展示了 APP_SLEEP0。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-6 | RESERVED | R | 0x0 | |
| 5 | DACB_SLEEP0 | R/W | 0x0 | 這些位控制在引腳或寄存器激活 APP_SLEEP0 功能時將哪些元件置于睡眠狀態(tài)（請參閱 TX_PIN_FUNC、SYNCB_PIN_FUNC、APP_SLEEP0_EN）。 注意：當 APP_SLEEP0/APP_SLEEP1 功能停用時，元件將逐漸重新啟用，以防止電源欠壓。 注意：當 MODE 寄存器為 1 或更高時，整個應(yīng)用層處于睡眠狀態(tài)，因此該寄存器無效。 注意：當 PFIR 為 DSP 輸入生成樣本時，PFIR 通道在 DSP 通道處于睡眠狀態(tài)時處于睡眠狀態(tài)。 注意：當 PFIR 為編碼器生成樣本時，PFIR 通道在編碼器處于睡眠狀態(tài)時處于睡眠狀態(tài)： 注意：當 PFIR 通道 0 正在向兩個編碼器廣播時，僅在兩個編碼器都處于睡眠狀態(tài)的情況下，PFIR 才處于睡眠狀態(tài)（請參閱 PFIR_BC）。 當 APP_SLEEP0 功能激活時，DACB 靜音（根據(jù) IDLE_STATIC），編碼器 1 處于睡眠狀態(tài)。 當 DSP 處于睡眠狀態(tài)時，如果 MODE 寄存器配置為正常運行，它仍然可以處理觸發(fā)事件。 |
| 4 | DACA_SLEEP0 | R/W | 0x0 | 當 APP_SLEEP0 功能激活時，DACA 被靜音（根據(jù) IDLE_STATIC），并且相關(guān)的編碼器處于睡眠狀態(tài)。 注意：如果 APP_SLEEP0 和 APP_SLEEP1 功能同時處于活動狀態(tài)，則任一功能請求元件（邏輯或）時，元件處于睡眠狀態(tài)。 |
| 3 | DSP3_SLEEP0 | R/W | 0x0 | 當 APP_SLEEP0 功能激活時，DSP 通道 3 處于睡眠狀態(tài)。 |
| 2 | DSP2_SLEEP0 | R/W | 0x0 | 當 APP_SLEEP0 功能激活時，DSP 通道 2 處于睡眠狀態(tài)。 |
| 1 | DSP1_SLEEP0 | R/W | 0x0 | 當 APP_SLEEP0 功能激活時，DSP 通道 1 處于睡眠狀態(tài)。 |
| 0 | DSP0_SLEEP0 | R/W | 0x0 | 當 APP_SLEEP0 功能激活時，DSP 通道 0 處于睡眠狀態(tài)。 |
表 8-22 展示了 APP_SLEEP1。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-6 | RESERVED | R | 0x0 | |
| 5 | DACB_SLEEP1 | R/W | 0x0 | 當 APP_SLEEP1 功能激活時，DACB 被靜音（根據(jù) IDLE_STATIC），并且相關(guān)的編碼器處于睡眠狀態(tài)。請參閱 APP_SLEEP0 的說明。 |
| 4 | DACA_SLEEP1 | R/W | 0x0 | 當 APP_SLEEP1 功能激活時，DACA 被靜音（根據(jù) IDLE_STATIC），并且編碼器 0 處于睡眠狀態(tài)。 |
| 3 | DSP3_SLEEP1 | R/W | 0x0 | 當 APP_SLEEP1 功能激活時，DSP 通道 3 處于睡眠狀態(tài)。 |
| 2 | DSP2_SLEEP1 | R/W | 0x0 | 當 APP_SLEEP1 功能激活時，DSP 通道 2 處于睡眠狀態(tài)。 |
| 1 | DSP1_SLEEP1 | R/W | 0x0 | 當 APP_SLEEP1 功能激活時，DSP 通道 1 處于睡眠狀態(tài)。 |
| 0 | DSP0_SLEEP1 | R/W | 0x0 | 當 APP_SLEEP1 功能激活時，DSP 通道 0 處于睡眠狀態(tài)。 |
表 8-23 展示了 APP_SLEEP0_EN。
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| 位 | 字段 | 類型 | 復(fù)位 | 說明 |
|---|---|---|---|---|
| 7-1 | RESERVED | R | 0x0 | |
| 0 | APP_SLEEP0_EN | R/W | 0x0 | 設(shè)置后，根據(jù) APP_SLEEP0 寄存器，元件將進入睡眠狀態(tài)。當需要對應(yīng)用程序睡眠進行精細控制，但不需要專用引腳來激活時，可使用此選項。您可以保留該寄存器設(shè)置并修改 APP_SLEEP0 寄存器以動態(tài)休眠/喚醒元件（當 SYS_EN=1 時）。 |